doxygen/html/nxp__s32z2__clock_8h_source.html

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#define NXP_S32_ETH1_TX_RGMII_CLK                  188U

#define NXP_S32_ETH1_PS_TX_CLK                     189U

#define NXP_S32_P1_LFAST0_REF_CLK                  190U

#define NXP_S32_P1_LFAST1_REF_CLK                  191U

#define NXP_S32_P1_NETC_AXI_CLK                    192U

#define NXP_S32_P1_LIN_CLK                         193U

#define NXP_S32_P1_REG_INTF_CLK                    194U

#define NXP_S32_P2_DBG_ATB_CLK                     195U

#define NXP_S32_P2_REG_INTF_CLK                    196U

#define NXP_S32_P3_AES_CLK                         197U

#define NXP_S32_P3_CLKOUT_SRC_CLK                  198U

#define NXP_S32_P3_DBG_TS_CLK                      199U

#define NXP_S32_P3_REG_INTF_CLK                    200U

#define NXP_S32_P3_SYS_MON1_CLK                    201U

#define NXP_S32_P3_SYS_MON2_CLK                    202U

#define NXP_S32_P3_SYS_MON3_CLK                    203U

#define NXP_S32_P4_CLKOUT_SRC_CLK                  204U

#define NXP_S32_P4_DSPI60_CLK                      205U

#define NXP_S32_P4_EMIOS_LCU_CLK                   206U

#define NXP_S32_P4_LIN_CLK                         207U

#define NXP_S32_P4_PSI5_125K_CLK                   208U

#define NXP_S32_P4_PSI5_189K_CLK                   209U

#define NXP_S32_P4_PSI5_S_BAUD_CLK                 210U

#define NXP_S32_P4_PSI5_S_CORE_CLK                 211U

#define NXP_S32_P4_PSI5_S_TRIG0_CLK                212U

#define NXP_S32_P4_PSI5_S_TRIG1_CLK                213U

#define NXP_S32_P4_PSI5_S_TRIG2_CLK                214U

#define NXP_S32_P4_PSI5_S_TRIG3_CLK                215U

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#define NXP_S32_P4_PSI5_S_WDOG1_CLK                218U

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#define NXP_S32_P4_PSI5_S_WDOG3_CLK                220U

#define NXP_S32_P4_QSPI0_2X_CLK                    221U

#define NXP_S32_P4_QSPI0_1X_CLK                    222U

#define NXP_S32_P4_QSPI1_2X_CLK                    223U

#define NXP_S32_P4_QSPI1_1X_CLK                    224U

#define NXP_S32_P4_REG_INTF_2X_CLK                 225U

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#define NXP_S32_P4_SDHC_IP_CLK                     227U

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#define NXP_S32_P5_CANXL_PE_CLK                    231U

#define NXP_S32_P5_CANXL_CHI_CLK                   232U

#define NXP_S32_P5_CLKOUT_SRC_CLK                  233U

#define NXP_S32_P5_LIN_CLK                         234U

#define NXP_S32_P5_REG_INTF_CLK                    235U

#define NXP_S32_P6_REG_INTF_CLK                    236U

#define NXP_S32_PIT0_CLK                           237U

#define NXP_S32_PIT1_CLK                           238U

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#define NXP_S32_SPI0_CLK                           272U

#define NXP_S32_SPI1_CLK                           273U

#define NXP_S32_P1_DSPI_CLK                        274U

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#define NXP_S32_CORE_PLL_REFCLKOUT                 287U

#define NXP_S32_CORE_PLL_FBCLKOUT                  288U

#define NXP_S32_PERIPH_PLL_REFCLKOUT               289U

#define NXP_S32_PERIPH_PLL_FBCLKOUT                290U


#endif /* ZEPHYR_INCLUDE_DT_BINDINGS_CLOCK_NXP_S32Z2_CLOCK_H_ */